Keysight N5980A 比特誤碼率測試儀

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  主要特性與技術指標

  • Dramatically simplified transceiver measurements that provide just the essential tests via the one page graphical user interface (running on an external Windows® XP PC via a USB 2.0 interface)
  • Standard measurements at fixed rates between 125 Mb/s and 3.125 Gb/s
  • Generation of Pseudo Random Bit Sequence (PRBS) polynomials and a K28.5 pattern at Low Voltage Differential Signal (LVDS) or Emitter Coupled Logic (ECL) levels
  • Optical and electrical error injection (once or at selectable Bit-Error-Ratio)
  • Analysis of gated Bit-Error-Ratio with display of the absolute number of errors and selectability of gate time
  • Flexible connections to the device under test via 3.5 mm differential electrical coax connectors and/or standard optical SFP module plug-ins
  • Full programmability of all graphical user interface features from another software program, making automation in manufacturing an easy task

  描述

  Keysight N5980A 3.125 Gb/s生產用串行BERT(比特誤碼率測試儀)可對制造收發模塊的過程進行測試，其價格只是當前N4906B BERT的三分之一。它還具有獨立的電接口和光接口(SFP插件)，提供雙倍的zui大吞吐率。除了具有價格優勢以外，它還把測試成本降低了6倍。

  另外，N5980A的體積縮小了6倍，節省了寶貴的空間，進一步降低了測試成本。因此，尤其針對低成本、高吞吐率的測試應用而言（比如千兆位收發模塊制造），它已經成為有吸引力的測試解決方案。

   

  • 速率范圍155 Mb/s到3.125 Gb/s之間的標準測量。
  • 在低壓差分信號 (LVDS) 或發射極耦合電路(ECL)電平上生成偽隨機二進制序列(PRBS)多項式和K28.5碼型。
  • 通過3.5 mm差分同軸電連接器和/或標準光SFP模塊插件，靈活地連接到被測器件上。
  • 光電接口差錯產生(單次產生或者按照可選的比特誤碼率)。
  • 分析門選通比特誤碼率，可以顯示誤碼的數量和選擇門選通時間。
  • 大幅簡化收發模塊測量，通過USB 2.0接口連接到外置Windows® XP電腦上的單頁圖形用戶界面，從而進行基本測試。
  • 全面的圖形化可編程，配合相關軟件程序，使生產自動化測試成為一項輕松的任務。
  • Data rate The same data rate applies for pattern generator electrical out and optical out, and for error detector electrical in and optical in. Data rates Fast Ethernet 125 Mb/s OC-3 155.52 Mb/s OC-12 622.08 Mb/s OC-48 2.48832 Gb/s OC-48 with FEC 2.66606 Gb/s 1 x FC 1.0625 Gb/s 2 x FC 2.125 Gb/s 1 x Gigabit Ethernet 1.25 Gb/s XAUI 3.125 Gb/s Accuracy ± 50 ppm Operating system The software supplied runs on Windows 2000, XP or 7 with .NET v2.0, by a USB 2.0 interface. Pattern Generator Pattern The following patterns are supported: PRBS: 27-1, 215-1, 223-1, 231-1. Data pattern: K28.5. Clock pattern: data rate divide by n, n=2,4,8,10,16,20 The pattern can be individually adjusted for pattern generator electrical out and optical out. Error injection Fixed electrical and optical error inject: Fixed error ratios of 1 error in 10n bits, n=3,4,5,6,7,8,9. Single error injection. Separate error ratios can be adjusted for pattern generator electrical out and optical out. Pattern generator electrical out A differential electrical output is provided on the front-panel. Out/Out Output type differential, AC-coupled, external 100 Ω differential termination Amplitude, selectable ECL 850 mVpp typ., single-ended 1700 mVpp typ., differential LVDS 400 mVpp typ., single-ended 800 mVpp typ., differential Jitter peak-peak 0.05 UI typ. @ OC-12 0.08 UI typ. @ GbE 0.15 UI typ. @ OC-48 Connector SMA, front panel Pattern generator optical out A standard SFP housing is provided. Minimum number of insertion/deinsertion cycles: 200. Trigger output A single-ended, electrical output is provided on the front-panel. Trigger out Output type single-ended Impedance 50 Ω nominal, AC-coupled Amplitude 850 mV typ. Clock rate, selectable data rate divided by n, n=2,4,8,10,16,20 Connector SMA, front Panel Error Detector A differential electrical input is provided on the frontpanel. Data rate is the same as pattern generator. Pattern The following patterns are supported: PRBS: 27-1, 215-1, 223-1, 231-1. In/In Input type differential, AC-coupled Max. input amplitude 1 Vpp, single-ended 2 Vpp, differential Impedance 100 Ω nominal Sensitivity < 50 mV Clocking mode internal CDR Synchronization automatically on level, polarity, phase, bit and pattern Connector SMA, front panel
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